关于return to zero resample switch feedthru 的从source 到d - EE版

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EE版 - 关于return to zero resample switch feedthru 的从source 到d

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s***d
发帖数: 15421

这是某个paper的截图，人家用的是bjt，只不过我打算用cmos去实现。
resampling 也就是当 D D_bar稳定时，ck switches 在去sample 一下，这样产生
return to zero 信号。
现在的问题是D D_bar变化的时候，是正好当ck是0（不变化）的时候，此时管子M1
turn off M2 turn on。这时候由于D&D_bar的变化，M1&M2 source 会有glitch 电流
。按照我的想法是，大部分电流应该从cgs 留走了或者从M2 溜走（M2是turn on），为
啥仿真的时候，依然可以从load 发现明显的glitch。
另外，我发现我用spectrum 测的M1 的 drain的电流和load（load接在M1的drain上）
电流不一样大，load 电流会有明显的glitch，而drain 却没有。是不是因为drain 并
不包含cgd的电流？
各位牛人给瞅瞅看了。

s***d
发帖数: 15421

问题解决了，device 的engineer说是model的charge partition 设置有问题。

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