m*******5
发帖数: 24 | 1 各位大神们好！
我现在想把存在asynchronous sram里的数据以至少125MHZ 的频率读出来。读出来的数
据不需要反馈给pc, output signal 直接连到我要测试的芯片上作为switch signal.
因为是asynchronous所以直接给出第一个address然后让address每8ns增加一感觉就可
以了吧？
所以我现在的问题是，有没有这种address generator circuit或类似的东西能实现这
个目的的？把这个ckt和sram弄到pcb上。
希望这个电路越简单越好 不想使用fpga或者mcu什么的，不知道能不能实现，请大家
指点！
谢谢了！ |
a****l
发帖数: 8211 | 2 我觉得你还是用现成的设备产生这个信号比较好。如果你不是电路设计的老手的花，
125M的信号连线差一点就会出问题的，不要想随便搭个电路焊几条电线就能搞定了。而
且好的情况是你的电路不工作这样你还知道有问题，最糟糕的情况是你的电路偶尔会产
生干扰的错误，然后你的测试有时对有时错，或者看上去是对的其实是错的，你会死的
很难看的。
【在 m*******5 的大作中提到】
: 各位大神们好！
: 我现在想把存在asynchronous sram里的数据以至少125MHZ 的频率读出来。读出来的数
: 据不需要反馈给pc, output signal 直接连到我要测试的芯片上作为switch signal.
: 因为是asynchronous所以直接给出第一个address然后让address每8ns增加一感觉就可
: 以了吧？
: 所以我现在的问题是，有没有这种address generator circuit或类似的东西能实现这
: 个目的的？把这个ckt和sram弄到pcb上。
: 希望这个电路越简单越好 不想使用fpga或者mcu什么的，不知道能不能实现，请大家
: 指点！
: 谢谢了！
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i*****t
发帖数: 24265 | 3 弄个软件循环读取内存，然后把bus上数据拿来用？ |
m*******5
发帖数: 24 | 4 有什么现成的设备可以用？
【在 a****l 的大作中提到】
: 我觉得你还是用现成的设备产生这个信号比较好。如果你不是电路设计的老手的花，
: 125M的信号连线差一点就会出问题的，不要想随便搭个电路焊几条电线就能搞定了。而
: 且好的情况是你的电路不工作这样你还知道有问题，最糟糕的情况是你的电路偶尔会产
: 生干扰的错误，然后你的测试有时对有时错，或者看上去是对的其实是错的，你会死的
: 很难看的。
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b***i
发帖数: 3043 | 5 你要给出真正的需求，而不是“用SRAM”,这个是解决方案。如果你不能完成解决方案
，不要增加到需求里面去。最适合你的就是FGPA。
【在 m*******5 的大作中提到】
: 有什么现成的设备可以用？
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a****l
发帖数: 8211 | 6 顺便加一句，现在的很多fpga都是集成ram的，基本就是用于这种东西的。
【在 b***i 的大作中提到】
: 你要给出真正的需求，而不是“用SRAM”,这个是解决方案。如果你不能完成解决方案
: ，不要增加到需求里面去。最适合你的就是FGPA。
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c*******c
发帖数: 726 | 7 这个必然是需要fpga或者mcu的，至少你直接飞线出来信号同步是不可控的 |
b***i
发帖数: 3043 | 8 目前看来，你需要学习的技术包括FPGA，高速电路设计。不要局限自己在MATLAB，SRAM
等。这些其实不难，花几个月学学就行了。
我帮你随便做了一个移位器，达到500MHz不成问题。但是你要说清楚你最终的目的到底
是什么。FPGA也可以用LabVIEW来设计，很容易。
如果你实在要自己做，给你一些相关的信息。Micrel的串并转换SY87725L 可以达到超
过1Gbps的数据率。相当于你可以把其中一路的信号以4倍的低速并行给出。不一定肯定
就是这个芯片，但是容易找到很多类似的芯片你可以用。SY100EP195 可以进行jitter
的微调，精度为25皮秒。
设备基本都是1路的，没听说有8路的。当然你发生一个3.2G的信号，转并行400M也可以
。但到底是不是你想要的，你要自己说清楚。
【在 m*******5 的大作中提到】
: 有什么现成的设备可以用？
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m*******5
发帖数: 24 | 9 这位大神 之前在另一个帖子好像就聊过 我给你发了邮件 不知道你收到没有？
这个matlab和sram的方法是教授提的 而且专断的不得了。之前说写入的方法已经解决
了 用一个data acquisition card和matlab 里的module直接慢慢写入就可以了。
现在的问题就是怎样吧sram里面的8位数据高速读出来，信号不需要反馈给pc，只要出
现在输出端口就好，这样再把sram端口和需要测试的芯片连起来从而达到控制测试芯片
里每个power amp开关的作用。
我现在的sram是个asynchronous 512k 8bit的，access time 8 ns. 所以想要以125MHz
的速度读出数据，就要给出sram地址信号。之前听人提过address generator这种东西
，就是让地址信号从0高速一位一位增加。但是我找不到相关信息。所以现在比较困惑
。不知道你知道这个怎么做么？
你说这个移位器我不太了解怎么运作的，能达到这个作用么？另外这个信号必须是8位
的，因为在测试芯片里有8个power amplifier。必须同时控制他们。
教授说这应该是个很简单的电路。。我怎么看都觉得复杂。。
SRAM
jitter
【在 b***i 的大作中提到】
: 目前看来，你需要学习的技术包括FPGA，高速电路设计。不要局限自己在MATLAB，SRAM
: 等。这些其实不难，花几个月学学就行了。
: 我帮你随便做了一个移位器，达到500MHz不成问题。但是你要说清楚你最终的目的到底
: 是什么。FPGA也可以用LabVIEW来设计，很容易。
: 如果你实在要自己做，给你一些相关的信息。Micrel的串并转换SY87725L 可以达到超
: 过1Gbps的数据率。相当于你可以把其中一路的信号以4倍的低速并行给出。不一定肯定
: 就是这个芯片，但是容易找到很多类似的芯片你可以用。SY100EP195 可以进行jitter
: 的微调，精度为25皮秒。
: 设备基本都是1路的，没听说有8路的。当然你发生一个3.2G的信号，转并行400M也可以
: 。但到底是不是你想要的，你要自己说清楚。
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b***i
发帖数: 3043 | 10 给你打了两次电话都没有人接，还是在这里讨论比较好，有多个人给你参考。
这个电路说简单也简单，说复杂也复杂，教授就是眼高手低。他自己做肯定做不出来。
8位没有问题，你到底什么精度的要求要说清楚。你内存给出32位的数然后4个一组进行
并串转换，就很容易得到8路的信号。这样150M也就需要150/4<40MHz的内存访问。我看
你直接用MCU去读内存都可以。要不用计数器什么的，Binary counter,比如MC10E016:
ECL 8-Bit Synchronous Binary Counter。不用串行并行转换，直接8位也可以。
用FPGA更适合。移位就是说你定义一个模块，有时钟输入，有reset输入，有输入端，
输出端，再加一个开关决定是从输出来循环到输入，还是从输入端读数。最后每个时钟
下进行移位，这个verilog最多20行程序完成。然后你把这个模块实例8个就是8位，根
本没有难度。你告诉教授你用SRAM+FPGA。然后你既可以完全用FPGA搞定，又可以用
FPGA+SRAM。
125MHz
【在 m*******5 的大作中提到】
: 这位大神 之前在另一个帖子好像就聊过 我给你发了邮件 不知道你收到没有？
: 这个matlab和sram的方法是教授提的 而且专断的不得了。之前说写入的方法已经解决
: 了 用一个data acquisition card和matlab 里的module直接慢慢写入就可以了。
: 现在的问题就是怎样吧sram里面的8位数据高速读出来，信号不需要反馈给pc，只要出
: 现在输出端口就好，这样再把sram端口和需要测试的芯片连起来从而达到控制测试芯片
: 里每个power amp开关的作用。
: 我现在的sram是个asynchronous 512k 8bit的，access time 8 ns. 所以想要以125MHz
: 的速度读出数据，就要给出sram地址信号。之前听人提过address generator这种东西
: ，就是让地址信号从0高速一位一位增加。但是我找不到相关信息。所以现在比较困惑
: 。不知道你知道这个怎么做么？
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t*******e
发帖数: 1633 | 11 我不相信你用不同于你教授说的方法做出来你教授会有任何脾气。如果有建议尽早换教
授。 |
i*****t
发帖数: 24265 | 12 光增加地址不行，还要有读写信号和时钟和时序要求吧。
另外最好用别人建议的fpga方法，而不是去直接飞线读sram。
好奇啥power amp io需要几百兆频率控制？PWM也没那么高吧
125MHz
【在 m*******5 的大作中提到】
: 这位大神 之前在另一个帖子好像就聊过 我给你发了邮件 不知道你收到没有？
: 这个matlab和sram的方法是教授提的 而且专断的不得了。之前说写入的方法已经解决
: 了 用一个data acquisition card和matlab 里的module直接慢慢写入就可以了。
: 现在的问题就是怎样吧sram里面的8位数据高速读出来，信号不需要反馈给pc，只要出
: 现在输出端口就好，这样再把sram端口和需要测试的芯片连起来从而达到控制测试芯片
: 里每个power amp开关的作用。
: 我现在的sram是个asynchronous 512k 8bit的，access time 8 ns. 所以想要以125MHz
: 的速度读出数据，就要给出sram地址信号。之前听人提过address generator这种东西
: ，就是让地址信号从0高速一位一位增加。但是我找不到相关信息。所以现在比较困惑
: 。不知道你知道这个怎么做么？
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m*******5
发帖数: 24 | 13 fpga 听起来好像很容易的感觉。。我跟教授说说 看他同意不同意用fpga吧。。
如果用binary counter做的话，我这个sram是512k*8, 那就是说需要19个address line
, 这是不是就要用19bit 的binary counter? mc10e016这个是min count frequency
700MHz 但是我这个sram最快是125MHz，是不是就不能用了？
所以我要找一个大于19bit,min count frequency<125MHz的binary counter?
【在 b***i 的大作中提到】
: 给你打了两次电话都没有人接，还是在这里讨论比较好，有多个人给你参考。
: 这个电路说简单也简单，说复杂也复杂，教授就是眼高手低。他自己做肯定做不出来。
: 8位没有问题，你到底什么精度的要求要说清楚。你内存给出32位的数然后4个一组进行
: 并串转换，就很容易得到8路的信号。这样150M也就需要150/4<40MHz的内存访问。我看
: 你直接用MCU去读内存都可以。要不用计数器什么的，Binary counter,比如MC10E016:
: ECL 8-Bit Synchronous Binary Counter。不用串行并行转换，直接8位也可以。
: 用FPGA更适合。移位就是说你定义一个模块，有时钟输入，有reset输入，有输入端，
: 输出端，再加一个开关决定是从输出来循环到输入，还是从输入端读数。最后每个时钟
: 下进行移位，这个verilog最多20行程序完成。然后你把这个模块实例8个就是8位，根
: 本没有难度。你告诉教授你用SRAM+FPGA。然后你既可以完全用FPGA搞定，又可以用
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m*******5
发帖数: 24 | 14 之前说不用fpga因为必须要用wire连接fpga和PA Chip,会很容易产生delay mismatch.
如果要解决这个mismatch你有什么建议么？我觉得是不是用一个lvds tranceiver就可
以了？这个lvds trancever哪个公司有比较多比较好的产品？
谢谢！
【在 b***i 的大作中提到】
: 给你打了两次电话都没有人接，还是在这里讨论比较好，有多个人给你参考。
: 这个电路说简单也简单，说复杂也复杂，教授就是眼高手低。他自己做肯定做不出来。
: 8位没有问题，你到底什么精度的要求要说清楚。你内存给出32位的数然后4个一组进行
: 并串转换，就很容易得到8路的信号。这样150M也就需要150/4<40MHz的内存访问。我看
: 你直接用MCU去读内存都可以。要不用计数器什么的，Binary counter,比如MC10E016:
: ECL 8-Bit Synchronous Binary Counter。不用串行并行转换，直接8位也可以。
: 用FPGA更适合。移位就是说你定义一个模块，有时钟输入，有reset输入，有输入端，
: 输出端，再加一个开关决定是从输出来循环到输入，还是从输入端读数。最后每个时钟
: 下进行移位，这个verilog最多20行程序完成。然后你把这个模块实例8个就是8位，根
: 本没有难度。你告诉教授你用SRAM+FPGA。然后你既可以完全用FPGA搞定，又可以用
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i*****t
发帖数: 24265 | 15 其他方法怎么连接的？
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【在 m*******5 的大作中提到】
: 之前说不用fpga因为必须要用wire连接fpga和PA Chip,会很容易产生delay mismatch.
: 如果要解决这个mismatch你有什么建议么？我觉得是不是用一个lvds tranceiver就可
: 以了？这个lvds trancever哪个公司有比较多比较好的产品？
: 谢谢！
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m*******5
发帖数: 24 | 16 用pcb连接
【在 i*****t 的大作中提到】
: 其他方法怎么连接的？
:
: .
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w***g
发帖数: 5958 | 17 这个真是至理名言啊.
【在 b***i 的大作中提到】
: 你要给出真正的需求，而不是“用SRAM”,这个是解决方案。如果你不能完成解决方案
: ，不要增加到需求里面去。最适合你的就是FGPA。
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