v***6
发帖数: 42 | 1 一个synchronous的FIFO, 如果full信号在第n-1个clock cycle是低, 在第n个clock
cycle是高, 那么在第n个clock cycle, 写入端是否还能再写进FIFO一个数据呢?
具体信号时序如下,full和wr_en都是高有效, 请问data 2是否被写进了FIFO里?
clk: |<- cycle n-1 ->|<- cycle n ->|
full: | low | high |
wr_en: | high |
data_in:| data 1 | data 2 | |
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c****p
发帖数: 6474 | 2 取决于FIFO实现吧。
我现在做的project里面，full只是个信号，
靠写入端保证不在full的时候assert wr_en。
如果写入端硬给wr_en有效的话还是会写入的，
当然FIFO的数据就被破坏了；
FIFO也可以实现成full的时候wr_en不论是啥都无效，
但是这时候写入端认为已经写入的数据实际没写入，
最后也会出问题。
总而言之，这两种情况都会出问题，
所以应该在设计上保证full的时候wr_en为低。 |
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D**C
发帖数: 6754 | 3 也没说是fifo阿
LRU在java的implementation就是linkedhashmap,跟fifo没啥关系 |
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a********h
发帖数: 819 | 4 my understanding regarding buy/sell same stock in multiple brokerage
accounts
1. wash sale, I need to lump them together to consider as one account
2. FIFO, I can treat them as separate, since FIFO, you can specify which lot
you have that you want to sell
is the understanding correct? Thanks a lot |
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s****l
发帖数: 10462 | 5 我想大部分人卖一半的时候都没有指定卖哪一手吧，那就只能FIFO？我已经报了，不是
FIFO，等山姆大
叔查我吧。。。。
不过，我在卖ESPP的股票的时候会指定，因为涉及到是长期还是短期的问题。 |
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j****9
发帖数: 2295 | 6 IB中有这么三种。不知道计算gain/loss时哪种好呢？FIFO是不是对上升股票好些？
LIFO对下降的股票好些（避免wash sale）？
First In, First Out (FIFO), code = no code appears
Last In, First Out (LIFO), code = LI
Maximize Losses, code = ML |
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a******a
发帖数: 333 | 7 卖股票的时候怎么选fifo和lifo，我怎么没看见选项？默认是fifo了。
你这个例子long赚short亏，如果全卖了，总体赚，应该是交long term的税 |
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T*******h
发帖数: 112 | 8 赚不赚钱是指每次操作的卖出，你可以认为每次买入的股票都有个时间戳，所谓的FIFO
和LIFO不过就是默认先卖你什么时候买的罢了。至于选择啥策略完全看你自己了，没有
统一的。不想麻烦就一直默认FIFO就好了。 |
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v**c
发帖数: 112 | 9 有次和人谈这话题，我说看过资料，大概知道Asyn FIFO怎么设计，对方就让我画来看
看。我就画了block diagram，正要说怎么控制over/underflow，对方就说这些都不重
要，最难设计的就是那个dual port SRAM，我愕然，因为之前都不知道这个是难点。
我想问的是，怎么才能在学习中注意这个难点，或者说这类难点呢？因为像Asyn FIFO
，我没上过课，是自学的，就是google些相关的paper大概看一下，然后再看些HDL的例
子。在这些例子里面，dual port SRAM都是以很简单的形式出现，几句HDL就完成了这
个block，以至于我以为这样就OK了...
希望大家能指点下，在学习VLSI相关的技术时，怎样才能注意到这种在industry也许是
常识，但我这种闭门造车的人却忽视的细节呢？有些什么比较好的资源，或者学习方法
上要注意的呢？
非常感谢！ |
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h*******o
发帖数: 778 | 10 It's too difficult to enable full asserted and wr_en deasserted at the same
time. FIFOs should have some reserve space so that even full signal is on,
there is still space in FIFO and it doesn't hurt to write several more. |
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s**********r
发帖数: 8153 | 11 我一直觉得是stack。。。囧了。。。
毕竟浏览器点后退，退的是之前看的页面，再点，是再之前的。。。。
为啥是fifo呢？ |
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w********p
发帖数: 948 | 12 建议您google下 LRU, browser, fifo 和 stack |
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m*****i
发帖数: 4342 | 13 Unless you are classify as day trader, you can not use FIFO for your tax
return. |
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z****7
发帖数: 880 | 14 The Internal Revenue Service automatically assumes stock is sold on a first-
in, first out (FIFO) method. If this is the method you want to use, and it
is the method normally used by your brokerage firm, you do not need to do
anything other than give your broker instructions to sell. |
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t***a
发帖数: 5 | 15 大师们都用什么股票TAX stragety， 好像default是FIFO） 那个比较好一些？ |
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h*****9
发帖数: 26 | 16 之前卖了一些获利股，但是没有设置LIFO，如果按FIFO报税，要多好几千啊。 |
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c******y
发帖数: 3269 | 18 BSO "按FIFO报税，要多好几千"
LZ baozi |
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F*****t
发帖数: 2580 | 19 换了你，02，03年的PD看到06，07年PD的拿到卡了，自己却还要等，你也会要求FIFO的
。不能指望别人做出牺牲。 |
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c*****1
发帖数: 1826 | 20 FIFO should be confined within one country. |
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j********s
发帖数: 976 | 21 如果是FIFO， 是根据PD还是submit date？
谢过了 |
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v***6
发帖数: 42 | 22 FIFO的verilog好长啊, 记不住, 感觉考这个也没什么意义的, 真要用的时候copy&
paste就行了吧 |
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c********e
发帖数: 1209 | 23 可能性还是蛮大的吧，还可以算FIFO深度呢。呵呵 |
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v***6
发帖数: 42 | 24 请教楼上
为啥很难实现enable full asserted and wr_en deasserted at the same
time?
如果把(!full&&wr_en)连到FIFO的memory的write enable上, 行不行 |
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h*******o
发帖数: 778 | 25 Your approach keeps FIFO safe, but the writing data
may get lost when both full and wr_en is on. The sender needs cycles to get
the full signal (synchronization, long-distance communication latency). |
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T******T
发帖数: 3066 | 26 As general note in synchronous digital design, unless clock rate is slow and
absolutely necessary, refrain from using double edged sequential logic. I
would only use it for fast <-> real slow time domain synchronization related
stuff.
DDR sounds cool, and it might seem efficient as hell to be able to
accomplish twice as much operation in only 1 single clock cycle, but when it
comes time to backend STA timing closure, you'll regret not having that
extra slack to deal with worst path circuit delay... 阅读全帖 |
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r*****s
发帖数: 1815 | 27 严格的"FIFO"在多client下是不存在的，因为不存在准确的全球时钟
spanner目前是个怪胎，它的全球时钟实现暂时不考虑。
这里的FIFO只能认为是最简单情况，每个client的消息FIFO。（要保证clients之间的
causal order又会变得很复杂。。一般来说也没有这个需求吧。。）
所以结论基本就是client消息加编号咯。当且仅当0...n-1消息都收到时，才将n消息再
发给接收端。
WAL尽量保证故障恢复(因为要high throughput所以quorum不一定可以用)
最后如果因为种种原因真的卡了，那就真的卡了，选择timeout舍弃100%的FIFO还是选
择卡住等人来修，就是看requirement了。。。
: 可以打中文了，
: 不知道可不可以，如果像Kafka 那样， 怎么保证FIFO？ 有经验的朋友来谈谈
该怎么
: 处理这种问题？
: 比如即使不能做到所有的要求， 那在回答的时候该怎么回答（比如先保重1 |
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m*******l
发帖数: 12782 | 28 ☆─────────────────────────────────────☆
chugege (出格) 于 (Thu Mar 29 16:24:06 2012, 美东) 提到:
那些要求严格按PD排的是在作无用功。本身技术上不可行。法律上你也没证据。吵下去
就是一团糟，大家心里一团火，每个人都觉得自己亏大了。没什么意思。
按照飞猪说的，现在大家要做的是捆成一团，不再以个人利益为主，而是多一点公益心
，以集体利益为主，大家reach a consensus 到底什么才是对中国EB2利益最大化。然
后行动。这样你要你的，我要我的，没啥作为。
☆─────────────────────────────────────☆
cartoonhero (传声筒) 于 (Thu Mar 29 16:28:02 2012, 美东) 提到:
第一步应该是停止暗箱操作。
☆─────────────────────────────────────☆
Huan2007 (胡绵涛) 于 (Thu Mar 29 16:28:16 2012, 美东) 提到:
WSN不可能捆成一团
... 阅读全帖 |
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a****a
发帖数: 5763 | 29 http://bbs.weiphone.com/read.php?tid=517864
Mac OS X 10.6即所谓的Snow Leopard操作系统已正式发售。一如既往，Apple产品
光鲜的外表下凝聚了太多艰辛的劳作。ArsTechnic的John Siracusa以其独特的、专业
的、全面的视角深入翔实地体验这款最新的操作系统。
Weiphone.com将对该综述进行翻译整理并独家连载。欢迎关注
Grand Central Dispatch
上一篇连载《并行难题：一封19年前的挑战书(连载11/23)》中，我们讨论了
并行编程(parallel programming)的问题，以及该问题所导致的另一个更为深远问题，
那就是：近一二十年以来，尽管计算机硬件的发展已经迈上了一个新的台阶，然而“软
件”层面的发展却裹足不前，最终成为了限制计算机性能的主要因素之一。
针对这一问题，Snow Leopard的应对方案是Grand Central Dispatch(GCD)。
GCD是刚刚发布的Snow Leopard的一项新特性... 阅读全帖 |
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z****e
发帖数: 54598 | 30 换回我自己电脑，偷偷灌点水
其实我一直都不觉得MQ的q是算法里面那个q
这里面其实没有很严格的FIFO的概念
当然一般而言，都是fifo，但是
之后的处理是异步的，你没有办法控制哪个先得到处理
所以严格的fifo其实毫无意义
就算做到了严格的fifo又怎样？下一步就不能保证了
对不对？这个其实是一个component
fi可以保证，fo其实还涉及到处理模式
有些是一对一，有些是一对多的广播，这个其实怎么o都不一样
必要时候并发来解决性能问题也不是不可能
不要学得那么死板嘛，不过一工具而已 |
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f*********r
发帖数: 674 | 31 Asic engineer. front end. 本人做低端做得多, 对前端没啥经验. 问了什么是FIFO,
async FIFO和 sync FIFO的区别. 然后又问了verilog, formal verification还有
prime time的问题. tool问得非常具体, 如果没有用过那些option的话很难回答. 马上
就觉得那人不感兴趣了. move on了. |
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H******i
发帖数: 4704 | 32 概论
四月十五是美国非常重要的日子，因为那一天是美国报税的截止日。我们工作、投资等
各种收入都必须付税，因此若能够彻底了解税与投资的关系，您可以建立对您最有税利
的投资策略，增加税后收入。报税的过程往往十分复杂又耗时间，在此提醒您平日将您
的所有投资交易资料整理好，有备无患。第一理财税务中心可以提供您一些基本的税务
知识，若您还有其他较深的疑问，请与您的会计师或税务顾问联络。
专有名词
在我们开始之前，请先看看一些税务专有名词：
Schedule D 用来呈报投资资产损益的表格。若您今年有卖出股票，国税局规定您必须
交此表。
Dividends 股息 公司利益发放给股东的金额。联邦课税级别不同的投资人股息税率不
同，通常为5%至15%。
Interest Income 利息收入 来自於利息的投资收入。发放利息的投资项目包含国债、
公司债、储蓄债卷、定期存单、活动存款等等。
1099 若您该年投资活动有卖出证券，或累积利息超过$10.00，您就会收到此表格。您
必须有社会安全卡号码，用此表格与国税局报税。此表格一月底之前会发放给投资人。
表格内资料包含股息、不合格股息、利息、资本收益、... 阅读全帖 |
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b*******e
发帖数: 6389 | 33 给你copy一段。
Some folks might tell you that it doesn't matter, since you can simply come
up with an "average" cost for these shares. *Don't listen*. You don't have
the choice of "averaging" your cost for individual stocks and securities.
The rules for mutual funds do allow for averaging, but we're not talking
about mutual funds here.
When you sell a stock, you only have two options for reporting your cost
basis for tax purposes:
1. First In First Out (FIFO)
2. Specific Identification
The FIFO metho... 阅读全帖 |
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l*****l
发帖数: 4170 | 34 1/27/2014 TD Ameritrade
https://invest.ameritrade.com/grid/p/site#r=jPage/https://gainskeeper.
ameritrade.com/amtdGP/GainLoss.aspx?gainlosstype=realized&c_name=invest_
VENDOR 1/1
GOPRO INC Sell.LIFO 100 10/30/14 7,198.99 10/30/14 7,854.83 655.84 9.11
Short-term
GPRO Dec 20 2014 80.0 Call Sell to Close.FIFO 1,000 11/12/14 3,907.73 11/18/
14 7,682.09 3,774.36 96.59 Short-term
GPRO Jan 17 2015 75.0 Call 1,000 --- 7,517.73 --- 8,252.07 734.34 9.77 Short
-term
GPRO Nov 14 2014 80.0 Call Sell to Close... 阅读全帖 |
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L****n
发帖数: 12932 | 35 1/27/2014 TD Ameritrade
https://invest.ameritrade.com/grid/p/site#r=jPage/https://gainskeeper.
ameritrade.com/amtdGP/GainLoss.aspx?gainlosstype=realized&c_name=invest_
VENDOR 1/1
GOPRO INC Sell.LIFO 100 10/30/14 7,198.99 10/30/14 7,854.83 655.84 9.11
Short-term
GPRO Dec 20 2014 80.0 Call Sell to Close.FIFO 10,000 11/12/14 3,907.73 11/18/
14 7,682.09 3,774.36 96.59 Short-term
GPRO Jan 17 2015 75.0 Call 1,000 --- 7,517.73 --- 8,252.07 734.34 9.77 Short
-term
GPRO Nov 14 2014 80.0 Call Sell to Clos... 阅读全帖 |
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S******y
发帖数: 1330 | 36 我印象中的大潮，有很多老PD，觉得新PD比他们晚却早拿绿卡，很不公平，于是乎天天
给O要求FIFO，后来真的FIFO了——PD回05去了，老PD也没得到好处，新PD彻底绝望。
没有FIFO对老PD是不公平，可想想那些4年来没有工卡和AP的人——
当时的新PD都是老PD了吧，希望不要再发生类似这样的事情了。 |
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S*******r
发帖数: 11017 | 37 老PD没有DQ（documentarily qualified）之前为啥要放新人进来保证FIFO？难道不是
应该老PD已经DQ了再放人进来更能保证FIFO？难道你是说老PD都DQ了还不放新人进来，
等到DQ的老PD都绿了，没件可以去pre-adjudicate了，一窝蜂放进来一群人就搞不定
FIFO了？
奥本挑在这么个千载难逢的机遇（07大潮后遗症）放人，真是用心良苦啊。 |
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l**g
发帖数: 1914 | 38 理论上SECURITY CLEAR 的CASE 是按PD 的FIFO 批才对，
RD 的FIFO 是处理 BACKGROUND CHECK 等预处理工作。
所以应该有2个FIFO。 |
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y******0
发帖数: 8807 | 39 USCUS HQSCOPS
directs the service center to adhere to orderly FIFO(First in First out)
processing. This means that visa-available pending applications will not be
expedited or pulled out of order because doing so gives an unfair advantage
to newer cases by depriving older ones of a visa
We cannot pull the case out of the order to process. NSC is currently past
processing times on some EB 485 cases. We are aware of this situation and
have prioritized visa-available (BT) applications to be worked,... 阅读全帖 |
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y******0
发帖数: 8807 | 40 大部分情况应该是先交的。
USCUS HQSCOPS directs the service center to adhere to orderly FIFO(First in
First out) processing. This means that visa-available pending applications
will not be expedited or pulled out of order because doing so gives an
unfair advantage to newer cases by depriving older ones of a visa.
http://www.mitbbs.com/article_t/EB23/32316147.html
We cannot pull the case out of the order to process. NSC is currently past
processing times on some EB 485 cases. We are aware of this situation a... 阅读全帖 |
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z****e
发帖数: 2024 | 41 You are asked to design a map like data structure, which support look_up
by ID, remove by ID and FIFO look_up and FIFO remove.
FIFO stands for first in and first out.
How would to do it?
Thanks. |
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c****3
发帖数: 10787 | 42 那你可以把请求多传递几次。收到请求，给某个线程算座位，算好座位，把请求加上座
位号，放到FIFO的Queue里。
计数器线程只管从FIFO Queue的头读请求，它读到的请求，已经包含座位号。
FIFO多线程访问，可以用lock-free的算法，就是用atomic operation做的lock-free的
Queue。 |
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b***i
发帖数: 3043 | 43 是这样，我们的串口数据是9位的，一串数据发出去，要求其中一个char的第9位置1，
其他都清零。
start, bit0, bit1, bit2, bit3, bit4, bit5, bit6, bit7, bit8, stop, start,
bit0, ....
而Linux是不支持9位串口的。幸好，串口有parity，我们可以在用户空间的软件发一个
char的时候，自己计算好parity，让它满足我们的要求。问题:
1. Linux串口驱动处理的时候，有没有驱动层的FIFO?因为我们需要每个char单独设
parity,如果有FIFO,这个信息就会遗漏。
2. 这个要往深层里说，我们其实有硬件的实现，是FPGA，我们可以在硬件里面建立
FIFO,包括parity，从而保证不丢失第9位。但是，这个没做过。另外，我们自己做串口
，是否需要给Linux 中断都不是很清楚。
3. 接收的时候，按照任意一种parity，那么一定会有错。能否保证所有数据都受到？
我们到不知在意接收到的第9位是什么，可以忽略第9位。
有能解答的吗？有思路也行 |
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h****p
发帖数: 175 | 44 太好笑了，竟然有人装大牛。
1) Empty logic makes sense, but your full logic looks wrong.
Take FIFO depth of 6 for example: [0 | 1 | 2 | 3 | 4 | 5 ] ,
No read operation, just keep pushing into fifo,
when full,
wr_ptr = 3b'101, rd_ptr = 3'b0,
Using your logic of full = (wr_ptr== { ~re_ptr[3],re_ptr[2:0]});
full = (3'b101 == 3'b100) will compare false, but your fifo is really full.
看清楚再说，re_ptr[2:0]=3'b0， re_ptr[3]= 0.
re_ptr是4位的，
这个code功能上是没有问题的，至于为什么wr_ptr， re_ptr都是4位而不是3位，这位
大牛先去google一下吧。 |
|
w*****s
发帖数: 433 | 45 @psf:
多谢多谢！～
for 2）也就是说mux来switch不同频率的时钟信号是不宜的对吧？你说的方法就是设计
一组采样电路，接不同频率的clk，然后用clock enable信号来enable不同的采样电路？
for 3） 是类似于这样的code吗？：
if clk' event and clk=1 then
if (count<= length) then
count=count+1;
else
output<=0;
count<=0;
追加一个问题：
不知是否有人熟悉USB chip，比如cypress的。我把cypress的USB chip设置成slave
FIFO的工作模式，由外部输入48MHz的clk时钟（固定值，@ high speed model），这么
说也就是USB FIFO的读写频率是48MHZ了吧？那为什么说high speed USB传输率有450M
bit/s呢？而不是48M bit/s呢？ 还是说480M bit/s是峰值，也就是说USB chip FIFO一
次打包传出去的data speed？ 如... 阅读全帖 |
|
H******d
发帖数: 98 | 46 各位前辈们好！小弟之前发过一次求内推帖子，在这里：
http://www.mitbbs.com/article_t0/JobHunting/32654027.html
非常感谢前辈们的推荐，拿到一家大公司和小公司的面试，最终也进入了onsite，只可
惜经验不足都挂掉了。
总结一下经验：
1. 大公司的面试时面试官要求写Asynchronous FIFO的Verilog code，这块没准备好，
挂掉。面完之后立刻把Asynchronous FIFO的Verilog从头到尾自己写了一遍，把网上所
有关于ASIC/VLSI的面经过了两遍。
2. 自信满满去小公司onsite面试，所有技术问题都答出来了，但是其中有一轮的面试
官问我简历一个2年前的proj，问得很细，其中有个细节真心不记得了，所以答得不好
挂掉。面完之后立刻把简历上所有内容重新仔仔细细地回顾一遍，当初的proj代码也重
新写了一遍。
现在仍然在找ASIC/Digital相关的工作，所以厚着脸皮继续上来寻求前辈们的推荐，相
信这次一定可以拿下！
可站内联系我或者邮箱 i*******[email protected] 在此谢谢各位！ |
|
m******s
发帖数: 204 | 47 【 以下文字转载自 Programming 讨论区 】
发信人: metricss (metr), 信区: Programming
标 题: 请教一个系统设计问题
发信站: BBS 未名空间站 (Fri Feb 26 04:15:12 2010, 美东)
设计一个字符队列管理系统：总的字符队列数目不定，每个队列长度不定。预先不知道
最大有几个队列
界面要求：
Q * create_queue(); //Creates a FIFO byte queue, returning a handle to it.
void destroy_queue(Q * q); //Destroy an earlier created byte queue.
void enqueue_byte(Q * q, unsigned char b); //Adds a new byte to a queue.
unsigned char dequeue_byte(Q * q); //Pops the next byte off the FIFO queue.
1。 不准使用任何动态内存分配函数。所有的操作只能在 |
|
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v***6
发帖数: 42 | 49 非常感谢!
感觉你qualcomm面试的不错的
那是验证工程师的职位吗?
问题包罗万象 硬件,软件,computer architecture,DSP
那个让你写FIFO的, 是用verilog写个完整的fifo吗? |
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H******d
发帖数: 98 | 50 各位前辈们好！小弟之前发过一次求内推帖子，在这里：
http://www.mitbbs.com/article_t0/JobHunting/32654027.html
非常感谢前辈们的推荐，拿到一家大公司和小公司的面试，最终也进入了onsite，只可
惜经验不足都挂掉了。
总结一下经验：
1. 大公司的面试时面试官要求写Asynchronous FIFO的Verilog code，这块没准备好，
挂掉。面完之后立刻把Asynchronous FIFO的Verilog从头到尾自己写了一遍，把网上所
有关于ASIC/VLSI的面经过了两遍。
2. 自信满满去小公司onsite面试，所有技术问题都答出来了，但是其中有一轮的面试
官问我简历一个2年前的proj，问得很细，其中有个细节真心不记得了，所以答得不好
挂掉。面完之后立刻把简历上所有内容重新仔仔细细地回顾一遍，当初的proj代码也重
新写了一遍。
现在仍然在找ASIC/Digital相关的工作，所以厚着脸皮继续上来寻求前辈们的推荐，相
信这次一定可以拿下！
可站内联系我或者邮箱 i*******[email protected] 在此谢谢各位！ |
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